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  FPGA培训课程表

        培训结束后颁发工程师培训证书。

   班级规模及环境

        为了保证培训效果,增加互动环节,我们坚持小班授课,每期报名人数限3到5人。人手一机,全程实践。

   上课时间和地点

          上课地点:【上海】:同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山学院/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:佳源大厦(高新二路) 【成都分部】:领馆区1号(中和大道) 【沈阳分部】:沈阳理工大学/六宅臻品 【郑州分部】:郑州大学/锦华大厦 【石家庄分部】:河北科技大学/瑞景大厦
        

    本课程每期班限额5名,报满即停止报名,请提前在线或电话预约

   课时

        ◆课时:5天,总计30学时
        ◆团体报名优惠措施:两人95折优惠,三人或三人以上9折优惠 。注意:在读学生凭学生证,即使一个人也优惠500元。
        ◆外地学员:代理安排食宿(需提前预定)
        ☆注重质量
        ☆边讲边练

        ☆合格学员免费推荐工作

        ☆合格学员免费颁发相关工程师等资格证书,提升您的职业资质

        专注高端培训15年,曙海提供的证书得到本行业的广泛认可,学员的能力
        得到大家的认同,受到用人单位的广泛赞誉。

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   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在下期培训班中重听;
        2、培训结束后,培训老师留给学员手机和Email,免费提供半年的技术支持,充分保证培训后出效果;
        3、培训合格学员可享受免费推荐就业机会。 ☆合格学员免费颁发相关工程师等资格证书,提升您的职业资质。专注高端培训13年,曙海提供的证书得到本行业的广泛认可,学员的能力得到大家的认同,受到用人单位的广泛赞誉。

   课程大纲
        全部授课内容均在计算机和实验器材上实际操作。 周末班、连续班、晚班任选

培训课程表

 

序号

最近开课时

FPGA培训课程表

X1

面向软件设计人员的基于 C 语言的 HLS 编码培训
C-based HLS Coding for Software Designers

面向软件设计人员的基于 C 语言的 HLS 编码培训
(C-based HLS Coding for Software Designers)

2015年6月8日

5天;
30学时

X2

Xilinx FPGA 的基本 DSP 实现技巧培训

Xilinx FPGA 的基本 DSP 实现技巧培训

2015年6月8日

5天;
30学时

X3

利用系统生成器(System Generator)实现的DSP设计培训

2015年6月8日

5天;
30学时

X4

设计Xilinx数字信号处理系统培训

2015年6月8日

5天;
30学时

X5

FPGA测试培训

2015年6月8日

5天;
30学时

X6

基于xilinx fpga的高速数据连接技术培训

2015年6月8日

5天;
30学时

X7
使用 Xilinx 模拟混合信号方案进行设计培训 2015年6月8日 5天;
30学时
X8
FPGA Power Optimization功能优化培训 2015年6月8日 5天;
30学时
X9
Xilinx 部分重配置工具和技术培训 2015年6月8日 5天;
30学时
X10
ISE 设计工具流程培训 2015年6月8日 5天;
30学时
X11
降低成本的 FPGA 设计技术培训 2015年6月8日 5天;
30学时
X12
利用 ChipScope Pro 工具实现的调试技术培训 2015年6月8日 5天;
30学时
X13
利用 PlanAhead 分析与设计工具进行基本设计培训
2015年6月8日 5天;
30学时
X14
利用 PlanAhead 设计分析工具进行高级设计培训
利用 PlanAhead 设计分析工具进行高级设计培训
2015年6月8日 5天;
30学时
X15
FPGA性能设计培训 2015年6月8日 5天;
30学时

X16

Vivado Design Suite 的高级工具和技术培训

Vivado Design Suite 的高级工具和技术培训

2015年6月8日

5天;
30学时

X17

Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训

Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训

2015年6月8日

5天;
30学时

X18

Vivado Design Suite 静态时序分析和 Xilinx 设计约束培训

2015年6月8日

5天;
30学时

X19

面向 ISE 软件用户的 Vivado Design Suite 高级 XDC 和静态时序分析培训

2015年6月8日

5天;
30学时

X20

面向 ISE 软件项目浏览器用户的 Vivado Design Suite培训

面向 ISE 软件项目浏览器用户的 Vivado Design Suite培训

2015年6月8日

5天;
30学时

X21

Vivado Design Suite Tool Flow(Vivado Design Suite 工具流程)培训

2015年6月8日

5天;
30学时

X22
如何设计高速存储器接口培训 2015年6月8日 5天;
30学时
X23
Xilinx FPGA 的信号完整性和开发板设计培训 2015年6月8日 5天;
30学时
X24
利用千兆位级串行 I/O 进行设计培训 2015年6月8日 5天;
30学时
X25
设计 Xilinx 连接功能系统培训 2015年6月8日 5天;
30学时
X26
FPGA设计方法培训FPGA Design Methodology 2015年6月8日 5天;
30学时
X27
使用5系列FPGA进行设计培训之
利用 Virtex-5 FPGA 系列进行设计培训
2015年6月8日 5天;
30学时
X28
使用6系列FPGA产品进行设计培训之利用 Spartan-6 和 Virtex-6 系列进行设计培训
2015年6月8日 5天;
30学时
X29
Altera FPGA设计技术培训
2015年6月8日 5天;
30学时

 
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.(2014年7月11).................................................................................................................................